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基于FPGA的遞歸神經(jīng)網(wǎng)絡(luò)加速器的研究進(jìn)展
關(guān)鍵詞：遞歸神經(jīng)網(wǎng)絡(luò) fgpa 加速器
摘要：遞歸神經(jīng)網(wǎng)絡(luò)(RNN)近些年來被越來越多地應(yīng)用在機(jī)器學(xué)習(xí)領(lǐng)域,尤其是在處理序列學(xué)習(xí)任務(wù)中,相比CNN等神經(jīng)網(wǎng)絡(luò)性能更為優(yōu)異。但是RNN及其變體,如LSTM、GRU等全連接網(wǎng)絡(luò)的計(jì)算及存儲(chǔ)復(fù)雜性較高,導(dǎo)致其推理計(jì)算慢,很難被應(yīng)用在產(chǎn)品中。一方面,傳統(tǒng)的計(jì)算平臺(tái)CPU不適合處理RNN的大規(guī)模矩陣運(yùn)算;另一方面,硬件加速平臺(tái)GPU的共享內(nèi)存和全局內(nèi)存使基于GPU的RNN加速器的功耗比較高。FPGA由于其并行計(jì)算及低功耗的特性,近些年來被越來越多地用來做RNN加速器的硬件平臺(tái)。對(duì)近些年基于FPGA的RNN加速器進(jìn)行了研究,將其中用到的數(shù)據(jù)優(yōu)化算法及硬件架構(gòu)設(shè)計(jì)技術(shù)進(jìn)行了總結(jié)介紹,并進(jìn)一步提出了未來研究的方向。
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